在X光安检机统中，X光安检机的主设备与控制台的双向通信具有非对称性，由主设备X射线端采样得到的大量数据通过高速通道传送至PC控制台进行处理。然而由控制台传送给安检机的控制信号，因数据量较小，仅需低速通道进行传输即可，并且在安检主设备端对于高速数据的处理是基于FPGA平台实现的，若同时采用单片FPGA对接收控制信号进行处理，一方面可减少硬件电路的设计负担，另一方面也降低了设备成本。 但与此同时，若该系统采用传统串行通信方式，则在处理高速数据的FPGA电路单元中引入低速时钟线，不仅容易受到电路板上高频信号的影响，而且由于控制台距离CT机距离较长，不利于时钟信号的传输。因此，对于安检机控制信号的传输一般采用单路串行低速通信方式。对于这种传输方式，在FPGA上采用一种高效的数字时钟提取技术就十分必要。